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聊聊反激電源的EMI設計

下面是PI經典的inno反激電源,應用比較廣泛。對于市電產品,如何通過傳導EMI測試呢,該如何改進呢,這里提供幾種方法可以嘗試下。

噪聲來自哪里?下面是反激開關器件的實際波形:

噪聲源頭:開關動點變化的電壓信號(等效電壓源);

噪聲強度:頻率與幅值(包含開關和振鈴兩重信號)。

VDS波形,關斷時存在高頻振鈴,這里存在高次諧波影響RE測試。

增大MOS的開通電阻可以降低原邊VDS的dV/dt, 但是PI這款反激電源開關管是集成在了芯片內部,無法直接調整。因此在供電源VCC去耦電容和內部驅動器之間串入電阻也是可以調整開通速度的,可以降低VDS斜率。

另一種方法是開關管漏源之間并聯電容,在一定程度上可以降低VDS的dv/dt以及改變頻點,但效率會降低,尤其是硬開關電源。這里不建議使用。

再有一種方法是使用RCD緩沖電路,可以抑制VDS尖峰電壓。

最后是Layout調整,原邊副邊功率回路應保證最小環路面積。

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htwdb
LV.7
2
01-16 16:05

反激電源EMI的抑制可以在電源中加入適當的電阻、電容和電感等元件,可以有效吸收和衰減高頻噪聲。

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旻旻旻
LV.8
3
01-16 22:13

合理設計接地系統,確保設備各部分的電位一致,降低電磁干擾的影響

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01-17 11:55

反激電源的EMI設計關鍵在于優化布局、選擇合適的元件和設計有效的濾波器。通過確保短路徑布局并使用地平面,可以降低電流回路的電感,從而減少EMI。此外,使用低EMI的開關元件和高質量的磁性元件能進一步降低電磁干擾,而設計輸入和輸出的LC濾波器則可以有效抑制高頻噪聲。同時,加裝金屬屏蔽對敏感電路部分進行保護也是降低EMI的重要措施。

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01-19 00:34

再有一種方法是使用RCD緩沖電路,可以抑制VDS尖峰電壓。

最后是Layout調整,原邊副邊功率回路應保證最小環路面積。PCB設計很關鍵

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tanb006
LV.10
6
01-19 13:27

兩個橋堆并聯也是我經常使用的方式,可以擴大散熱面積,降低二極管應力。

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01-22 11:09
@htwdb
反激電源EMI的抑制可以在電源中加入適當的電阻、電容和電感等元件,可以有效吸收和衰減高頻噪聲。

這些有一些效果,一方面在源頭降低,一方面添加吸收

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01-22 11:09
@旻旻旻
合理設計接地系統,確保設備各部分的電位一致,降低電磁干擾的影響

接地設計很重要,尤其是對于EMI測試

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01-22 11:11
@聽聽1234
反激電源的EMI設計關鍵在于優化布局、選擇合適的元件和設計有效的濾波器。通過確保短路徑布局并使用地平面,可以降低電流回路的電感,從而減少EMI。此外,使用低EMI的開關元件和高質量的磁性元件能進一步降低電磁干擾,而設計輸入和輸出的LC濾波器則可以有效抑制高頻噪聲。同時,加裝金屬屏蔽對敏感電路部分進行保護也是降低EMI的重要措施。

EMI關聯的因素比較多,要考慮成本綜合評估

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01-22 11:11
@瘋狂的西紅柿
再有一種方法是使用RCD緩沖電路,可以抑制VDS尖峰電壓。最后是Layout調整,原邊副邊功率回路應保證最小環路面積。PCB設計很關鍵

是的,最小環路面積這個很關鍵,很多拓撲電路都要這樣設計

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01-22 11:13
@tanb006
兩個橋堆并聯也是我經常使用的方式,可以擴大散熱面積,降低二極管應力。

是的,并聯有好處,均流方面有沒有經驗分享下

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地瓜patch
LV.8
12
01-23 21:17

EMI太難搞了,有時莫名其妙

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地瓜patch
LV.8
13
01-23 21:29
@聽聽1234
反激電源的EMI設計關鍵在于優化布局、選擇合適的元件和設計有效的濾波器。通過確保短路徑布局并使用地平面,可以降低電流回路的電感,從而減少EMI。此外,使用低EMI的開關元件和高質量的磁性元件能進一步降低電磁干擾,而設計輸入和輸出的LC濾波器則可以有效抑制高頻噪聲。同時,加裝金屬屏蔽對敏感電路部分進行保護也是降低EMI的重要措施。

確保短路徑布局確保最短的地回路

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01-27 00:36

EMI在開關電源中非常重要

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旻旻旻
LV.8
15
02-16 14:50

可以采用頻率抖動技術,使開關頻率在一定范圍內隨機變化,從而降低特定頻率下的電磁干擾

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02-20 00:15

增大MOS的開通電阻可以降低原邊VDS的dV/dt, 但是PI這款反激電源開關管是集成在了芯片內部,無法直接調整,為什么無法調整?

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only one
LV.8
17
02-21 00:11

增大MOS的開通電阻可以降低原邊VDS的dV/dt, 但是PI這款反激電源開關管是集成在了芯片內部,無法直接調整。那有什么好的辦法

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dy-XU5vrphW
LV.8
18
02-21 08:37

反擊電源的信號傳輸會一直穩定么

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dy-nmLUWFNr
LV.8
19
02-21 09:44

如何有效降低系統電源的EMI

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02-23 01:21

另一種方法是開關管漏源之間并聯電容,在一定程度上可以降低VDS的dv/dt以及改變頻點,但效率會降低,效率提高才行。

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dy-StTIVH1p
LV.8
21
02-23 15:45

反激電源的EMI設計有利于平衡信號傳輸

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