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OB2362A 做12V3A適配器帶不起載，怎么回事

電路圖PCB圖
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文晟
LV.4
2
2018-10-22 09:26
如題，帶載的時候一直在打嗝，做了三臺樣機，其中一臺可以帶載但是半載1.8A的時候也會打嗝，其他兩臺直接0-3A帶不起載，變壓器參數是PQ2620  40:5:7  650uH    反饋調了好多遍都不行，難道是干擾問題嗎
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文晟
LV.4
3
2018-10-22 10:32
有用過這款芯片的大神嗎
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2018-10-22 10:56
@文晟
如題，帶載的時候一直在打嗝，做了三臺樣機，其中一臺可以帶載但是半載1.8A的時候也會打嗝，其他兩臺直接0-3A帶不起載，變壓器參數是PQ2620 40:5:7 650uH  反饋調了好多遍都不行，難道是干擾問題嗎

逐漸加大負載，看Vcc是否在正常范圍。

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文晟
LV.4
5
2018-10-22 13:09
@ymyangyong
逐漸加大負載，看Vcc是否在正常范圍。
VCC是正常的，現在17V左右，范圍是10-26
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2018-10-22 15:00
@文晟
VCC是正常的，現在17V左右，范圍是10-26

看故障出現之前的VCC電壓

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文晟
LV.4
7
2018-10-22 15:05
@ymyangyong
看故障出現之前的VCC電壓

VCC那里我改用了M7  故障前后基本沒太大變化，打嗝的時候肯定也是跟著打嗝的，（還有就是FB腳波形有輕震蕩，FAE說是正常）我感覺和FB腳關系挺大的

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2018-10-22 16:54
@文晟
有用過這款芯片的大神嗎
和IC選型是沒有關系的
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2018-10-22 16:55
@文晟
如題，帶載的時候一直在打嗝，做了三臺樣機，其中一臺可以帶載但是半載1.8A的時候也會打嗝，其他兩臺直接0-3A帶不起載，變壓器參數是PQ2620 40:5:7 650uH  反饋調了好多遍都不行，難道是干擾問題嗎
是哪里保護動作了？
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文晟
LV.4
10
2018-10-22 17:16
@zz052025
和IC選型是沒有關系的
以前也設計過恒壓適配器，但是沒見過像這樣難調的，普通的適配器都是調一下高低壓平衡或者帶載能力強弱，沒見過DEMO資料做出來的東西帶不了負載的
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xiaojb11
LV.4
11
2018-10-24 14:48
PCB布板太亂了，建議重新layout
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291133609
LV.7
12
2018-10-24 16:05
@文晟
VCC是正常的，現在17V左右，范圍是10-26
有可能VCC極性搞反，IC過壓保護
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文晟
LV.4
13
2018-10-24 16:13
@xiaojb11
PCB布板太亂了，建議重新layout
額，你指的是哪個位置亂
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jlh213
LV.6
14
2018-10-24 17:02
@文晟
如題，帶載的時候一直在打嗝，做了三臺樣機，其中一臺可以帶載但是半載1.8A的時候也會打嗝，其他兩臺直接0-3A帶不起載，變壓器參數是PQ2620 40:5:7 650uH  反饋調了好多遍都不行，難道是干擾問題嗎
可能是你的3腳處有問題，分壓電阻還是得加上吧，要是這個地方超過3V，就會保護的。詳見規格書。
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andyrmz
LV.1
15
2018-10-25 15:46
變壓器參數設計不合理，匝比太小，初級加幾圈，試一試，初步懷疑電流值頂到了IPEK值了，太小導致，首先得確保繞制的相位不要反了
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jxlap001
LV.2
16
2018-10-25 16:34
那個散熱片怎么會這樣做呢？不安全的
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2018-10-25 22:59
電容下面怎么走高壓線跳線？畫板的技術還得提高啊
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文晟
LV.4
18
2018-10-26 10:29
@jxlap001
那個散熱片怎么會這樣做呢？不安全的
到時候初級端會包絕緣膠帶或者熱縮管
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文晟
LV.4
19
2018-10-26 10:31
@andyrmz
變壓器參數設計不合理，匝比太小，初級加幾圈，試一試，初步懷疑電流值頂到了IPEK值了，太小導致，首先得確保繞制的相位不要反了
變壓器匝比已經是8了，反射電壓現在理論值是8*12.5=100V  匝比感覺合理啊  再大的話MOS的峰值電壓我怕吃不消
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文晟
LV.4
20
2018-10-26 10:34
@明天海闊天空
電容下面怎么走高壓線跳線？畫板的技術還得提高啊
高壓不跳線，畫不了單面板吧，跳線生產會用帶線皮的那種，大電解也會用麥拉膠帶包起來。
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文晟
LV.4
21
2018-10-26 10:41
@jxlap001
那個散熱片怎么會這樣做呢？不安全的
有測過溫度，MOS和橋堆溫度不加散熱片沒問題，初級段包膠帶之后是不接觸散熱片的，散熱片不接初級地，這個還要改
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H_K_T
LV.3
22
2018-10-26 10:44
@文晟
高壓不跳線，畫不了單面板吧，跳線生產會用帶線皮的那種，大電解也會用麥拉膠帶包起來。
R11 R12 R13是三個15R的并聯？5R電流檢測電阻太大了吧，改到0.5R試試
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文晟
LV.4
23
2018-10-26 10:48
@H_K_T
R11R12R13是三個15R的并聯？5R電流檢測電阻太大了吧，改到0.5R試試
是三個1.5R的 ，哈哈  圖不是很清晰，現在快調好了
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xiaojb11
LV.4
24
2018-10-26 11:24
@文晟
額，你指的是哪個位置亂
一，貼片應盡量朝有利于過爐的方向，既美觀也利于加工。二，電解下面走高壓跳線加大成本和加工難度，盡量改成地線跳線。三，地線走的雜亂無章啊，懷疑是這個原因導致干擾大了。布板需要改善，找一些布板要領的資料琢磨一下，你會覺得再布一次板即好看干擾又小的
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文晟
LV.4
25
2018-10-26 15:16
@xiaojb11
一，貼片應盡量朝有利于過爐的方向，既美觀也利于加工。二，電解下面走高壓跳線加大成本和加工難度，盡量改成地線跳線。三，地線走的雜亂無章啊，懷疑是這個原因導致干擾大了。布板需要改善，找一些布板要領的資料琢磨一下，你會覺得再布一次板即好看干擾又小的
嗯，多謝指導，不過這個外形尺寸，元器件布局已經固定了，如果不想高壓跳線就只能雙面板了，那樣的話地線就好走很多，
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2018-10-26 19:18
@明天海闊天空
電容下面怎么走高壓線跳線？畫板的技術還得提高啊
什么原因導致的
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文晟
LV.4
27
2018-10-27 10:20
@jlh213
可能是你的3腳處有問題，分壓電阻還是得加上吧，要是這個地方超過3V，就會保護的。詳見規格書。
確實是3腳的問題，已解決，不過不是加下拉，是把R4阻值加大，帶載就正常了，另外我在變壓器磁芯包了銅箔落地，解決了響聲問題。
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powerled
LV.4
28
2018-10-29 10:59
@jlh213
可能是你的3腳處有問題，分壓電阻還是得加上吧，要是這個地方超過3V，就會保護的。詳見規格書。

這哥們就是牛X，一語中的。

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文晟
LV.4
29
2018-10-29 15:58
問題已解決，總結1:這顆芯片3腳集成了OVP功能（常規芯片OVP在FB腳），沒改之前VCC是17.5V  OVP點設置在了18V  故出現保護帶不起負載；2:變壓器響聲問題（FB波形震蕩），是反饋431供電不足導致，改小R18為1K就解決了。 謝謝大家的幫助！
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dy-IPKFckC5
LV.1
30
2020-05-27 20:55
@文晟
問題已解決，總結1:這顆芯片3腳集成了OVP功能（常規芯片OVP在FB腳），沒改之前VCC是17.5V OVP點設置在了18V 故出現保護帶不起負載；2:變壓器響聲問題（FB波形震蕩），是反饋431供電不足導致，改小R18為1K就解決了。謝謝大家的幫助！

你好，請問我輸出20V 3.25A 碰到低壓正常，升到輸入12V就觸發保護，3腳R4是102K，R5是15k

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mfkdcet
LV.8
31
2020-06-17 18:31
@dy-IPKFckC5
你好，請問我輸出20V3.25A碰到低壓正常，升到輸入12V就觸發保護，3腳R4是102K，R5是15k

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