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【DIY大賽】+反激+挑戰自己,高功率密度DC-DC隔離電源的設計5V20A。

看到活動,心癢,手也癢。

肚子里沒多少墨水,也要來摻和下。

預計設計一款外尺寸是50.8*50.8*12.7mm的電源。

功率上,準備挑戰100W。

僅僅是挑戰,能不能成不一定,但改好幾次是肯定的了。

邊調試邊修改。


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chebd
LV.6
2
2018-08-23 09:05
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2018-08-23 09:56
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2018-08-23 15:14

       前輩你好!有個問題想請教一下,為什么我調試的一款反激電源的MOS DS端波形會有CCM、DCM波形并存的情況?MOS DS波形和PWM開關波形如下圖波形所示。請前輩指點一二。

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2018-08-23 19:47
@伊若夏秋
      前輩你好!有個問題想請教一下,為什么我調試的一款反激電源的MOSDS端波形會有CCM、DCM波形并存的情況?MOSDS波形和PWM開關波形如下圖波形所示。請前輩指點一二。[圖片][圖片][圖片]

看你的波形很有規律,

是不是用內置MOS的芯片?

現在有些新的芯片,有抖頻功能,或者是輕載間歇工作。

你這個是輕載時候的樣子。

如果是3842這類的芯片,是不會有這樣波形的。

即使有,也沒這么規矩。沒這么有規律。

38系列芯片出現這樣的波形,那是環路沒有調好。

你可以試著加大負載,看看波形是不是會連續起來。

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2018-08-23 19:57

這個電源輸入是18--36VDC

輸出5V 20A 

高度并不高,所以需要用到平面變壓器。

這里有點小難度。打樣一個16層板的平面變壓器線圈,費用大約是兩千多塊。

思考了好幾天,決定分成兩塊一模一樣的8層板來做。這樣也就花費一千多塊就夠了。

電路設計用 UC2843 來做。次級用 UCC24610 做同步整流。

初級和次級的MOS管都用貼片封裝的。手頭有5*6封裝的80V MOS。

粗略計算了下,初級和次級都可以用這顆MOS。也省的去再買新料了。省點錢先。


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2018-08-23 20:10
@tanb006
這個電源輸入是18--36VDC輸出5V20A 高度并不高,所以需要用到平面變壓器。這里有點小難度。打樣一個16層板的平面變壓器線圈,費用大約是兩千多塊。思考了好幾天,決定分成兩塊一模一樣的8層板來做。這樣也就花費一千多塊就夠了。電路設計用UC2843來做。次級用UCC24610做同步整流。初級和次級的MOS管都用貼片封裝的。手頭有5*6封裝的80VMOS。粗略計算了下,初級和次級都可以用這顆MOS。也省的去再買新料了。省點錢先。

自己算了下先,

磁芯選用TDK的 ELP22 。材質是PC95.

網上買來2塊錢一副。沒有打字,但是有配套的卡扣,可以不用膠帶,這樣裸著對散熱還有好處。

這個磁芯的AE比較大,80個平方毫米。頻率選擇在145K。

選這個頻率的目的只有一個,那就是次級可以只要一匝。初級3匝。輔助繞組2匝。

匝數越少,變壓器走線越方便。

嗯,先畫變壓器去。

這里說下,多層板的變壓器,出于經濟方面的考慮,不要畫盲孔。盡量利用半邊畫成通孔。

做盲孔的成本要高大約30--100%。對于自己玩玩來說還是太奢侈了。

所以我并不會直接畫一個8層的變壓器PCB。

而是先做一個模型。來驗證小信號,和漏感、氣隙等其他參數。

下一樓會用不到一百塊來做這個能工作的變壓器模型。只有平面變壓器PCB成本的1/20哦。

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2018-08-23 20:33
@tanb006
自己算了下先,磁芯選用TDK的ELP22。材質是PC95.網上買來2塊錢一副。沒有打字,但是有配套的卡扣,可以不用膠帶,這樣裸著對散熱還有好處。這個磁芯的AE比較大,80個平方毫米。頻率選擇在145K。選這個頻率的目的只有一個,那就是次級可以只要一匝。初級3匝。輔助繞組2匝。匝數越少,變壓器走線越方便。嗯,先畫變壓器去。這里說下,多層板的變壓器,出于經濟方面的考慮,不要畫盲孔。盡量利用半邊畫成通孔。做盲孔的成本要高大約30--100%。對于自己玩玩來說還是太奢侈了。所以我并不會直接畫一個8層的變壓器PCB。而是先做一個模型。來驗證小信號,和漏感、氣隙等其他參數。下一樓會用不到一百塊來做這個能工作的變壓器模型。只有平面變壓器PCB成本的1/20哦。

/upload/community/2018/08/23/1535026871-38911.pdf

這里先付上磁芯的PDF資料。

可以看到窗口高度是3.2毫米。

這里開始講如何用100塊成本來做到接近2000塊打樣費的平面變壓器。

窗口的高度是關鍵。因為這關系到我的下一步工作。

柔性PCB可以做到0.2毫米的厚度。這正好是個優勢。

假設,我畫幾個不同的線圈,初級3匝,次級1匝,這就是兩個PCB。

畫在一個板上,一起打樣,也不會超過100塊的。

回來再拆開,堆疊。自制一個多層PCB模型。

我做過0.2mm基板的PCB,銅厚是2盎司,板子的總厚度達到了0.36mm 算上中間的絕緣膠紙,粗略可以當0.4mm來計算。

窗口剛好可以放下8片。剛好可以依次放 P S P  S P S P 。

四層NP穿插三層NS。剩下一丁點空間留給膠帶吧。不能太滿了。

輔助繞組就隨便用銅絲在空隙處繞2匝就OK。

當然,這樣做出來的PCB打樣價格會超過200塊,因為銅厚加價了。我們就做普通的0.5盎司標準工藝就OK。

畢竟只是驗證,不用考慮工藝。我只要波形就好。

驗證好了繞法和工藝,再去花一千多打樣8層板的PCB繞組也不遲。

不知道各位還有沒有更好的做平面變壓器的方法。我經驗不足,這是我能想到的對我來說最劃算的方法了。


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fysh
LV.5
9
2018-08-23 22:01
這個功率密度不算高
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2018-08-23 22:28
@fysh
這個功率密度不算高

我做著玩滴。其實我不知道自己幾斤幾兩,

正好能遇到高人點撥,那我也算是沒瞎折騰。

制作過程我會堅持不斷更新,或一兩天來一次,或三五天有點進度。

也希望各位看到不足之處能給指正。謝謝了!

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2018-08-24 08:36
@tanb006
看你的波形很有規律,是不是用內置MOS的芯片?現在有些新的芯片,有抖頻功能,或者是輕載間歇工作。你這個是輕載時候的樣子。如果是3842這類的芯片,是不會有這樣波形的。即使有,也沒這么規矩。沒這么有規律。38系列芯片出現這樣的波形,那是環路沒有調好。你可以試著加大負載,看看波形是不是會連續起來。
我用的是uc2845,當前負載約30w,試著增大到60w波形也是這樣
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2018-08-24 20:40
@伊若夏秋
我用的是uc2845,當前負載約30w,試著增大到60w波形也是這樣

有沒有原理圖貼上來看看,另外,設計的參數也發一下。

包括電感量等等的。發出來,大伙都能幫你看看。

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xiaojb11
LV.4
13
2018-08-25 10:53
@tanb006
我做著玩滴。其實我不知道自己幾斤幾兩,正好能遇到高人點撥,那我也算是沒瞎折騰。制作過程我會堅持不斷更新,或一兩天來一次,或三五天有點進度。也希望各位看到不足之處能給指正。謝謝了!
關注一下
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fysh
LV.5
14
2018-08-26 18:56
@fysh
這個功率密度不算高
3比1 有點少 頻率太低了
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2018-08-26 22:32
@fysh
3比1有點少頻率太低了

3:1只是假設。

頻率的確定取決于最少的匝數:1匝。

在初級或者次級,任意線圈匝數為1的時候,

我認為,這已經是這個電源的最高頻率了。

再往上,要作0.5匝也并非不可以。只是磁耦合會非常不理想。

還有一個限制頻率的原因,在200K以上,即使在空載,MOS管的開關損耗也是非常大的。


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fysh
LV.5
16
2018-08-26 23:59
@fysh
這個功率密度不算高
不知道你咋坐哈 我們做的低壓反激 都是200k到300k 效率最高有93點幾
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fysh
LV.5
17
2018-08-27 00:02
@fysh
這個功率密度不算高
33x22x10 可以做70w
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2018-08-28 22:28
@fysh
不知道你咋坐哈我們做的低壓反激都是200k到300k效率最高有93點幾

能到93已經很不錯了。畢竟初級電流太大。初級MOS的硬開關都是不小的損耗。

如果變壓器不做好,漏感的損耗也很可觀。

特別是在平面變壓器上,如果不用PCB來做線圈,如何減小漏感,是個很有意思的話題。

下面有空的時候我會單獨的談一下如何在無骨架的情況下繞制一個漏感低于0.5%初級電感的變壓器。

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2018-08-28 22:31
@fysh
33x22x10可以做70w

有點高端。想必是用了一些特殊的方法,例如:軟開關,llc?

我這個帖子就只用UC2843來做,硬開關,次級同步整流。期望能有接近89%的效率就很好了。

只是想在反激里邊再挖掘一些寶貝,制作的過程中能學到些知識。


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fysh
LV.5
20
2018-08-30 15:27
@fysh
這個功率密度不算高
你這個可以低些頻率 磁芯大
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fysh
LV.5
21
2018-08-30 15:28
@fysh
這個功率密度不算高
三明治撒
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fysh
LV.5
22
2018-08-30 15:45
@fysh
這個功率密度不算高
低于 0.5不好測試
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fysh
LV.5
23
2018-08-30 15:45
@fysh
這個功率密度不算高
低于 0.5不好測試
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fysh
LV.5
24
2018-08-30 15:45
@fysh
這個功率密度不算高
低于 0.5不好測試
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2018-08-30 23:30
@fysh
低于0.5不好測試

測電感量是好測試的,我這單位有臺300K的電橋。

你說的0.5是匝數?

還是漏感占初級電感量的百分比?

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2018-08-31 13:11
@fysh
不知道你咋坐哈我們做的低壓反激都是200k到300k效率最高有93點幾
你們怎么做的?用的什么控制芯片?
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2018-08-31 13:17
@fysh
不知道你咋坐哈我們做的低壓反激都是200k到300k效率最高有93點幾
fysh你們低壓反激用的什么控制芯片?
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2018-08-31 18:24
@伊若夏秋
      前輩你好!有個問題想請教一下,為什么我調試的一款反激電源的MOSDS端波形會有CCM、DCM波形并存的情況?MOSDS波形和PWM開關波形如下圖波形所示。請前輩指點一二。[圖片][圖片][圖片]
你這示波器好用嗎 多少價入的
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2018-09-02 10:55
@伊若夏秋
      前輩你好!有個問題想請教一下,為什么我調試的一款反激電源的MOSDS端波形會有CCM、DCM波形并存的情況?MOSDS波形和PWM開關波形如下圖波形所示。請前輩指點一二。[圖片][圖片][圖片]
這示波器用著怎么樣
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fysh
LV.5
30
2018-09-02 11:12
@fysh
這個功率密度不算高
0.5%本來電感量就小
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fysh
LV.5
31
2018-09-02 11:13
@tanb006
測電感量是好測試的,我這單位有臺300K的電橋。你說的0.5是匝數?還是漏感占初級電感量的百分比?
就是硬開關的也有90%
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