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DC/DC電源干擾問題

目前手頭有個DC/DC電源,干擾比較嚴重,請朋友們支支招,先大致說明下情況:

該DC/DC電源輸入是12V(電池電壓輸入),輸出7路,1路6V(做反饋),6路18V(做驅動輸出),芯片用的是LM3478。

目前該DC/DC的問題是,對輸入地有500mV以上的噪聲,噪聲頻率就是DC/DC的開關頻率,由于變壓器工藝較差,目前通過變壓器初級吸收濾波,延長驅動時間,以及開關管DS加吸收等,最后開關管的DS還剩一個25V左右的尖峰。

最大的問題是該震蕩同時影響了我的控制電路,我的供電回路是這樣的:電池電壓---控制板---電源板,該12V同時為我控制板提供12轉5V,3.3V等,最后再傳到開關電源,等于我現在電源部分把控制部分干擾了,當系統跑起來時,外部輸出電流增大時(6路輸出驅動模塊,模塊輸出通過導流條再驅動電機(72V電機,電池供電),此時電源板的輸出功率是不變的,唯一變的就是導流條上的電流在逐漸增大),控制部分的干擾就被放大。

目前的接地處理是控制板的數字地與模擬地都通過電容接到外殼,電源板在控制板正下方,12V與地都是從控制板引過來,電源板未接外殼。

請問該如何有效屏蔽DC/DC的干擾?

試過很多方法都不理想,后來單獨給電源板也引一個地出來接到外殼,噪聲從500mV以上降到200mV左右。

靜態下看似情況有好轉,但當外部輸出電流增大后,控制部分采樣的干擾依舊被放大,隨著外部輸出電流的增大噪聲也被放大,惡劣程度跟原先差不多。

求指教,為何在

外部輸出增大時,噪聲會被放大,該如何解決,謝謝!

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j5956
LV.3
2
2014-05-22 09:00
求指導
0
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2014-05-22 13:57
學習!!
0
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suichan
LV.3
4
2014-05-22 16:51
有沒有可能是Layout的關系呢?小訊號的接地與主回路大電流的地不可以混在一起。
建議在PCB板上用跳線方式去debug試試看。
0
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j5956
LV.3
5
2014-05-23 09:07
@suichan
有沒有可能是Layout的關系呢?小訊號的接地與主回路大電流的地不可以混在一起。建議在PCB板上用跳線方式去debug試試看。
信號地與模擬地是分開的
0
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